arch/blackfin/lib/ins.S

   1 /*
   2  * File:         arch/blackfin/lib/ins.S
   3  * Based on:
   4  * Author:       Bas Vermeulen <bas@buyways.nl>
   5  *
   6  * Created:      Tue Mar 22 15:27:24 CEST 2005
   7  * Description:  Implementation of ins{bwl} for BlackFin processors using zero overhead loops.
   8  *
   9  * Modified:
  10  *               Copyright 2004-2006 Analog Devices Inc.
  11  *               Copyright (C) 2005 Bas Vermeulen, BuyWays BV <bas@buyways.nl>
  12  *
  13  * Bugs:         Enter bugs at http://blackfin.uclinux.org/
  14  *
  15  * This program is free software; you can redistribute it and/or modify
  16  * it under the terms of the GNU General Public License as published by
  17  * the Free Software Foundation; either version 2 of the License, or
  18  * (at your option) any later version.
  19  *
  20  * This program is distributed in the hope that it will be useful,
  21  * but WITHOUT ANY WARRANTY; without even the implied warranty of
  22  * MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE.  See the
  23  * GNU General Public License for more details.
  24  *
  25  * You should have received a copy of the GNU General Public License
  26  * along with this program; if not, see the file COPYING, or write
  27  * to the Free Software Foundation, Inc.,
  28  * 51 Franklin St, Fifth Floor, Boston, MA  02110-1301  USA
  29  */
  30
  31 #include <linux/linkage.h>
  32
  33 .align 2
  34
  35 ENTRY(_insl)
  36         P0 = R0;        /* P0 = port */
  37         cli R3;
  38         P1 = R1;        /* P1 = address */
  39         P2 = R2;        /* P2 = count */
  40         SSYNC;
  41         LSETUP( .Llong_loop_s, .Llong_loop_e) LC0 = P2;
  42 .Llong_loop_s: R0 = [P0];
  43 .Llong_loop_e: [P1++] = R0;
  44         sti R3;
  45         RTS;
  46
  47 ENTRY(_insw)
  48         P0 = R0;        /* P0 = port */
  49         cli R3;
  50         P1 = R1;        /* P1 = address */
  51         P2 = R2;        /* P2 = count */
  52         SSYNC;
  53         LSETUP( .Lword_loop_s, .Lword_loop_e) LC0 = P2;
  54 .Lword_loop_s: R0 = W[P0];
  55 .Lword_loop_e: W[P1++] = R0;
  56         sti R3;
  57         RTS;
  58
  59 ENTRY(_insb)
  60         P0 = R0;        /* P0 = port */
  61         cli R3;
  62         P1 = R1;        /* P1 = address */
  63         P2 = R2;        /* P2 = count */
  64         SSYNC;
  65         LSETUP( .Lbyte_loop_s, .Lbyte_loop_e) LC0 = P2;
  66 .Lbyte_loop_s: R0 = B[P0];
  67 .Lbyte_loop_e: B[P1++] = R0;
  68         sti R3;
  69         RTS;